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作业第1章 数字逻辑系统 第1章作业
1、 
评分规则: 以下答案应该把补码和反码反过来。
2、 
评分规则: 
3、 
评分规则: 
4、 
评分规则: 
5、 
评分规则: 
6、 
评分规则: 
7、 请写出一个“三人表决电路”的“与或”逻辑表达式，A、B、C中A有一票决定权。
评分规则: 
第1章 数字逻辑系统 第1章测验
1、 余3码是 码，减3后是 码，然后加上后六种状态是 码。
答案: 无权，8421BCD，8421
2、 对于题图1.2所示的波形, A、B为输入，F为输出，其反映的逻辑关系是
答案: 异或关系;
无法判断
3、
答案: 1，1，0
4、 已知逻辑函数F=A（B+DC），选出下列可以肯定使F=1的状态是 。
答案: AB=1，C=0，D=0
5、 某一逻辑函数真值确定后，下面描述该函数功能的方法中，具有唯一性的是 。
答案: 逻辑函数的最小项之和表达式
6、 卡诺图中的逻辑相邻或对称相邻具有 码特征，其数值不同只是在位上差 位。
答案: 格雷码， 1
7、
答案: 同或
8、 信号A和0异或相当于 门，信号A和1异或相当于 门。（作答请以顿号“、”间隔）
答案: 缓冲门、非门
9、 
答案: ×、m、×、×、M、×
10、 在题图1.7所示的卡诺图中，化简后的逻辑函数是
答案: 
11、 最小项ABCD的逻辑相邻项是 。
答案: 
12、 任意项和约束项有微小的区别，区别在于任意项值随便，约束项值不允许。约束项和任意项统称为 。（作答请以顿号“、”间隔）
答案: 无关项
作业第2章 逻辑门电路 第2章作业
1、 
评分规则: 
2、 
评分规则: 
3、 
评分规则: 
4、 
评分规则: 
5、 如果晶体管基极-射极输入是理想的矩形波，且能使晶体管导通与截止。在集电极-射极输出的波形是非理想的矩形波。（判断对错题）
评分规则: 对
第2章 逻辑门电路 第2章测验
1、 ECL逻辑门电路电压摆率为
答案: 0.8V
2、 TTL电路时间延迟的主要原因是由载流子的聚集和消散引起的，CMOS反相器产生传输延迟的主要原因是由于集成电路 。
答案: 内部电阻和容性负载
3、 CMOS非门是由一个NMOS和一个PMOS组成，其栅极相连作为输入，漏极相连作为输出，NMOS源极需接 电平，PMOS源极接 电平。
答案: 低、高
4、 双极型TTL两种载流子工作的电流控制器件在抗幅射能力方面比单极型CMOS一种载流子工作的电压控制器件 。因为射线辐射对 浓度影响不大。
答案: 弱、多子
5、 双极型CMOS电路实现逻辑功能采用 器件，驱动输出级采用 射极跟随输出电路。
答案: CMOS；TTL
6、 增加去耦合滤波电容为了消除 ，每一个芯片的电源与地之间接一个0.01uF~0.1uF的电容器滤除 。
答案: 尖峰电流；开关噪声
7、 TTL电路驱动CMOS电路，仅考虑 。
答案: 电压匹配
8、 由NMOS增强型管制成的有源负载。
答案: 栅极和电源连接在一起；;
是两端元件；
9、 典型TTL非门中的T1什么时候处于倒置状态？
答案: 输入接高电平；;
前级输出高电平。
10、 I2L的主要性能可选以下哪些？
答案: 功耗低；;
结构简单；
11、 CMOS逻辑门有静态功耗和动态功耗能之分
答案: 动态功耗是输入信号和输出信号以一定频率切换时的功耗。;
静态功耗是输出电平不变的时候。
12、 CMOS的基本单元是CMOS反相器和CMOS传输门。
答案: 正确
作业第3章 组合逻辑电路 第3章作业
1、 
评分规则: 
2、 请设计一表决电路。共有4人参加某学生集体的三好生投票，多数人投赞成票可以通过，其中班主任投否决票不通过，即班主任具有一票否决权。
评分规则: 
3、 
评分规则: 
4、 请用74283实现一个可控余3码至8421BCD码和8421BCD码至余3码转换电路。当X=0时实现余3码至8421BCD码，X=1时实现8421BCD码至余3码。
评分规则: 
5、 用8选1数据选择器设计一个组合逻辑电路。该电路有3个输入逻辑变量A、B、C和1个工作状态控制变量M。当M=0时电路实现“意见一致”功能（A、B、C状态一致时输出为1，否则输出为0），而M=1时电路实现“多数表决”功能，即输出与A、B、C中多数的状态一致。
评分规则: 
第3章 组合逻辑电路 第3章测验
1、 一组合电路输入信号的变化顺序有以下三种情况，当 时，将可能出现竞争冒险。
答案: 00→01→10→11
2、 串行加法器进位信号采用 传递，而并行加法器的进位信号采用 传递。
答案: 逐位，超前
3、
答案: 110
4、 一个十六路数据选择器，其地址输入端有 个。
答案: 4
5、 采用4位比较器7485对两个四位二进制数进行比较时，先比较 位。
答案: 最高
6、 4线-10线译码器中输出状态只有F2=0，其余输出端均为1，则它的的输入状态应取
答案: 0010
7、 在下列逻辑电路中，是组合逻辑电路的有_____。
答案: 译码器;
编码器;
全加器
8、 门电路的延时时间是产生组合逻辑电路竞争与冒险的唯一原因。
答案: 错误
9、 数据分配器的结构与数据选择器相反，它是一种1路输入，多路输出的逻辑电路。从哪一路输出取决于地址控制端。
答案: 正确
10、 使能端的作用是克服竞争冒险和功能扩展。
答案: 正确
11、 清除竞争冒险的常用方法有（1）电路输出端加 ；（2）输入加 ；（3）增加 。（作答请用顿号“、”间隔）
答案: 电容、选通脉冲、冗余项
12、 一个有使能端的译码器作数据分配器时，将数据输入端信号连接在 。
答案: 使能端
第4章 时序逻辑电路 第4章测验
1、 具有约束条件的触发器有 。
答案: 主从RS触发器
2、 主从RS触发器不能完全克服多次翻转的原因是 。
答案: 主从RS触发器的主触发器工作原理和同步RS触发器相同
3、 主从触发器的时钟在高电平时，将输入信号传递到 。在低电平时，将信号传递到 。（A）从触发器输出 （B）主触发器输出 （C）JK触发器输出 （D）D触发器输出
答案: B、A
4、 
答案: A
5、 抗干扰能力最弱的触发器是 。
答案: 主从RS触发器
6、 维持阻塞RS触发器利用 , 在时钟CP的边沿传递数据, 传输延迟D触发器利用 , 在时钟CP的边沿传递数据。（A）门的延时 （B）维持阻塞线 （C）脉冲的低电平 （D）高电平或低电平
答案: B、A
7、 分析传输延迟JK触发器之后, 发现CP在高电平时, 输出状态 。CP在低电平时，输出状态 。（A）不变 （B）为0 （C）为1 （D）改变
答案: A、A
8、 在时钟CP有效的情况下, 触发器输出的新状态等于输入信号的是 触发器。
答案: T
9、 指出下列哪种电路结构的触发器可以构成移位寄存器，哪些不能构成移位寄存器。如果能够，请在（ ）内画√，否则画×。 （A）RS锁存器（ ） （B）同步RS触发器（ ） （C）主从JK触发器（ ）（D）维持阻塞触发器（ ） （E）用CMOS传输门组成的边沿触发器（ ）
答案: ×、√、√、√、√
10、 主从RS触发器通过逻辑功能转换为D触发器，D触发器输出状态改变需要时钟的触发方式为 。
答案: 一个脉冲
11、 具有一次翻转特性的触发器有 。
答案: 主从JK触发器;
由主从JK触发器组成D触发器
12、 没有空翻现象的触发器有 。
答案: 维持阻塞RS触发器;
维持阻塞D触发器;
传输延迟JK边沿触发器
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